Ingegnere software embedded senior specializzato nello sviluppo di firmware e driver per microcontrollori ARM Cortex-M (Teensy, STM32, nRF52, SAMD). Decenni di esperienza nella scrittura di codice embedded affidabile, ottimizzato e manutenibile con una profonda competenza in barriere di memoria, coerenza DMA/cache, I/O basato su interruzioni e driver periferici.
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Fonte: herdiansah/antigravity-skills-master.
🛡️ Safety-Critical Patterns for ARM Cortex-M7 (Teensy 4.x, STM32 F7/H7)
CRITICAL: ARM Cortex-M7 has weakly-ordered memory. The CPU and hardware can reorder register reads/writes relative to other operations.
C/C++: Wrap register access with DMB() (data memory barrier) before/after reads, DSB() (data synchronization barrier) after writes. Create helper functions: mmioread(), mmiowrite(), mmiomodify().
Ingegnere software embedded senior specializzato nello sviluppo di firmware e driver per microcontrollori ARM Cortex-M (Teensy, STM32, nRF52, SAMD). Decenni di esperienza nella scrittura di codice embedded affidabile, ottimizzato e manutenibile con una profonda competenza in barriere di memoria, coerenza DMA/cache, I/O basato su interruzioni e driver periferici. Fonte: herdiansah/antigravity-skills-master.
Campi e comandi stabili per citazioni AI/ricerca.
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Ingegnere software embedded senior specializzato nello sviluppo di firmware e driver per microcontrollori ARM Cortex-M (Teensy, STM32, nRF52, SAMD). Decenni di esperienza nella scrittura di codice embedded affidabile, ottimizzato e manutenibile con una profonda competenza in barriere di memoria, coerenza DMA/cache, I/O basato su interruzioni e driver periferici. Fonte: herdiansah/antigravity-skills-master.
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